プラットホーム・マネージャー

故障ログとダイナミック電力削減機能を持つスケーラブルな電源管理

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MachXO3

革新的な電源管理アーキテクチャ ～ 分散電源センスと一元化制御により、プラットホーム・マネージャは最大36系統の電源を容易に管理できます。また、故障ログ機能はデバッグ時間を短縮します。

ボードではなくアルゴリズムを変更 ～ ボード上にプラットホーム・マネージャがあると、気軽に設計変更できます。PCBを手直ししなくても、プラットホーム・マネージャをプログラミングし直すだけで設計変更に対応できます。

許容電力量がボード性能を制限していませんか? ～ プラットホーム・マネージャの精密な電圧スケーリング及びVID機能を使用すると、複雑で消費電力の多いASICやSoCを容易に制御できます。

特長

  • 集中型パワーアップ/ダウンシーケンス制御と電源検出
  • 電圧スケーリング/ VIDを使用したチップ消費電力の低減
  • 閉回路トリミングによる高精度電圧コントロール（10mV以下の精度）
  • 0.2％（typ）の精度で100μs以内に電圧障害（主要要因）を捉え、内蔵フラッシュに保存
  • システムがフィールドにある場合でも、モニター閾値、シーケンス、またはタイミングをすばやく変更可能

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ファミリーテーブル

電源管理デバイスファミリ・セレクタガイド

パラメータ LPTM10-1247 LPTM10-12107
     
アナログ入力 （シングルエンド） 5 0
アナログ入力 （差動） 7 12
総アナログ入力本数 12 12
専用のオープンドレイン出力 12 12
専用のデジタル入力 4 4
デジタルI/O 31 91
総デジタルI/O本数 47 107
マージン/トリミング本数 6 8
MOSFETドライバ出力 4 4
CPLDマクロセル数 48 48
FPGA LUT規模 640 640
パッケージ 128-pin TQFP 208-ball ftBGA

ソリューション

電力消費をデバイス単位で動的に制御することで、消費電力とシステム運用コストを削減

  • VIDによる動的な電力消費制御によって、ASIC及びプロセッサの消費電力を30%以上削減
  • 簡易な記述による電圧制御で、個々の電源要件を高めることなく、ボードの性能と機能を改善
  • DC-DCコンバータ動作設定のためのマイクロプロセッサとソフトウェアの必要性を排除

確実な故障ログを使用してボードの信頼性を高め、デバッグ時間を短縮

  • タイムスタンプ付きの不揮発性メモリにより、電源系が多数ある複雑なシステムでも故障の主要因を素早く特定
  • 全ての故障を発生後すぐにログし、全電源系統のステータスをキャプチャ。また、そのイメージをフラッシュメモリへ確実に直接保存
  • ボード故障の主原因を捕捉し、フラッシュメモリの意図せぬ書き換えと電源故障を容易に関連づけ可能

インシステム・プログラマブル電源管理によってフィールド保守コストを削減

  • インシステム・プログラマブル機能を使用して、システム運用中でも電源シーケンス制御アルゴリズムをフィールドで確実に更新可能
  • ゴールデンイメージでバックアップし、フェールセーフを確保した電源管理アルゴリズムの確実な更新
  • フィールドでの更新のために技術者を派遣する必要性を排除

電圧低下時にバックアップ電源へ16µs以内に素早く切り替える正確な調整

  • 電圧低下時でもスモールセルへの電源を維持
  • 高速で正確な電圧モニタリングにより、電圧低下時でも自動的にバックアップに切り替え

高い信頼性の活線挿抜制御回路を実装することで、最低コストのMOSFETを使用してシステムコストを低減

  • 高価なMOSFETを使用することなく、信頼性の高い大電力活線挿抜コントローラを実装可能
  • 必要なMOSFETの総数を削減し、かつ小型で低コストの一般的なMOSFETを使用可能

シングルチップでスケーラブルな電源管理ソリューションの再利用により、開発の期間と手間を削減

  • ワンチップでシステム帯域幅と電源要件が12系統から36系統までスケーラブルに対応可能
  • シーケンス制御アルゴリズムの機能分割が不要となり、電源管理の設計プロセスを簡素化
  • 電源のシーケンス制御を微調整できるため、ボードの電源投入時の信頼性を確保可能

デザインリソース

IP＆リファレンスデザイン

プレテスト、再利用可能な機能を利用して設計の労力を軽減

アプリケーションノート

当社のFPGA、開発ボードのラインナップを最大活用する方法

ソフトウェア

使いやすい設計フローの完全版

開発キット＆ボード

当社の開発キットとボードで設計プロセスの合理化

プログラミング　ハードウェア

当社のプログラミングハードウェアでインシステム・プログラミング、インサーキット再構成の負担を軽減

ドキュメント

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Technical Resources
Information Resources
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Controlling and Monitoring Power-One Bricks and SIPs with Lattice Power Manager Devices
AN605601.14/17/2008PDF216.1 KB
Creating Platform Manager Designs with PAC-Designer and Lattice Diamond Software
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Extending the VMON Input Range of Power/Platform Management Devices
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Fail-Safe Sequencing During Field Upgrades Source Files
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Fail-Safe Sequencing During Field Upgrades with Platform Manager
AN608801.26/6/2012PDF1.1 MB
High-side Current Sensing Techniques for Power Manager Devices
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Implementing Power Supply Sequencers with Power/Platform Management Devices and PAC-Designer LogiBuilder
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Interfacing the Trim Output of Power Manager II Devices to DC-DC Converters
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ispPAC-POWR1220AT8 I2C Hardware Verification Utility
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Lattice OrCAD Capture Schematic Library
This file contains an OrCAD Capture Schematic Library (OLB file type) for all Lattice products. This .zip file also includes a .xls worksheet with a list of the contents of the OLB. These symbols can be used to help with OrCAD schematic designs.		FPGA-SC-020059.16/26/2026ZIP3.3 MB
Monitoring and Controlling Negative Power Supplies with Power Manager Devices
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Optimizing the Accuracy of ispPAC Power Manager Timers
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Platform Manager Data Sheet
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Powering Up and Programming the ispPAC-POWR1014/A
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Powering Up and Programming the ispPAC-POWR1220AT8
AN607301.14/21/2011PDF171.2 KB
Powering Up and Programming the ispPAC-POWR607
AN607801.14/21/2011PDF1.3 MB
Powering Up and Programming the ProcessorPM ispPAC-POWR605
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Programmable Comparator Options for ispPAC-POWR1220AT8
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Programming the ispPAC-POWR1220AT8 in a JTAG Chain Using the ATDI Pin
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Scalable Centralized Power Management Source Files
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Scalable Centralized Power Management with Field Upgrade Support
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Stable Operation of DC-DC Converters with Power Manager Closed Loop Trim
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Using PAC-Designer's Power Manager Waveform Editor
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Using Power MOSFETs with Power/Platform Management Devices
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Using the HVOUT Simulator Utility to Estimate FET Ramp Times
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Using the Platform Manager Successfully
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Powering Up and Programming the ispPAC-POWR607
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Programmable Comparator Options for ispPAC-POWR1220AT8
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Stable Operation of DC-DC Converters with Power Manager Closed Loop Trim
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Platform Management Utility Functions IP Core User's Guide
IPUG9401.11/24/2011PDF551.8 KB
Platform Manager Development Kit Quick Start Guide
QS00913/27/2013PDF554.5 KB
Platform Manager Development Kit User's Guide
EB5801.212/7/2010PDF1.6 MB
Power Manager II Hercules Development Kit User's Guide
EB5701.012/22/2010PDF3 MB
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BSCAN1 - Multiple Boundary Scan Port Addressable Buffer - Documentation
FPGA-RD-021057.41/29/2021PDF993.7 KB
BSCAN1 - Multiple Boundary Scan Port Addressable Buffer - Source Code
RD10017.34/18/2011ZIP152.4 KB
BSCAN2 - Multiple Boundary Scan Port Linker - Source Code
RD10024.63/13/2014ZIP2.6 MB
BSCAN2 - Multiple Scan Port Linker - Documentation
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Closed Loop Power Supply Trimming Documentation
RD10781.012/6/2010PDF278.2 KB
Closed Loop Power Supply Trimming Source Code
RD10781.012/6/2010ZIP269.4 KB
Error Logging Using Platform Manager Documentation
RD10771.09/28/2010PDF422.5 KB
Error Logging Using Platform Manager Source Files
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GPIO Expander, Documentation
RD10651.34/12/2011PDF280.6 KB
GPIO Expander, Source Code
RD10651.34/12/2011ZIP195.5 KB
I2C (Inter-Integrated Circuit) Master Controller - Documentation
RD10055.83/6/2014PDF987.4 KB
I2C (Inter-Integrated Circuit) Master Controller - Source Code
RD10055.91/10/2015ZIP809.7 KB
Long Delay Timers Using Platform Manager Documentation
RD10791.19/28/2010PDF874.1 KB
Long Delay Timers Using Platform Manager Source Files
RD10791.09/28/2010ZIP683.9 KB
OrCAD Capture (.dsn) format schematics
19/28/2010ZIP0.7 KB
Platform Manager Dev Kit Initial Demo Source Files
RD1.11/26/2011ZIP1.1 MB
Platform Manager Dev Kit Power Supply Voltage Control (VID) Demo Source Files
1.012/6/2010ZIP1.1 MB
Power Management Bus Reference Design - Source Code
RD11001.112/23/2011ZIP378.3 KB
Power Management Bus Reference Design Documentation
FPGA-RD-020971.21/22/2021PDF1.1 MB
PWM Fan Controller
RD10601.69/10/2014PDF481.5 KB
PWM Fan Controller - Source Code
RD10601.71/16/2015ZIP2.9 MB
Temperature Monitor Using Platform Manager Documentation
RD10801.09/28/2010PDF330 KB
Temperature Monitor Using Platform Manager Source Files
RD10801.09/28/2010ZIP256.7 KB
UART (Universal Asynchronous Receiver/Transmitter) - Source Code
7/15/2025ZIP772.5 KB
UART (Universal Asynchronous Receiver/Transmitter) - User Guide
FPGA-RD-022701.87/15/2025PDF741.9 KB
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MachXO 300 mm Fab Transition Circuit Observations Mitigation
PB13772.06/12/2017PDF82.7 KB
TITLENUMBERVERSIONDATEFORMATSIZE
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ACN03D-11 Withdrawal of ACN03C-11
Material Set		ANC03D-1114/1/2011PDF796.6 KB
PCN 03A-15 Alternate Qualified Foundry / Mask Set and Alternate Qualified Material Sets for Platform Manager Products
Foundry, Mask Set, Material Set		PCN03A-152.011/23/2015PDF318.2 KB
PCN 03A-15 LPTM10 New MASK SET Yield and Parametric Analysis
PCN03A-151.011/23/2015PDF779.6 KB
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Lattice OrCAD Capture Schematic Library
This file contains an OrCAD Capture Schematic Library (OLB file type) for all Lattice products. This .zip file also includes a .xls worksheet with a list of the contents of the OLB. These symbols can be used to help with OrCAD schematic designs.		FPGA-SC-020059.16/26/2026ZIP3.3 MB
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Platform Manager Product Brochure
I02081.04/10/2012PDF2.8 MB
Platform Manager Product Brochure (Chinese)
I0208C1.06/4/2012PDF2.9 MB
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FTG208_LPTM10
Rev G16/9/2022PDF141.7 KB
TITLENUMBERVERSIONDATEFORMATSIZE
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Fast and Efficient Board and Power Management Solutions (Chinese Language)
1.04/1/2011PDF502.3 KB
Reset Generation for TI DSP Processor
1.03/1/2010PDF64.9 KB
Reset Generation for TI DSP Processor (Chinese Language)
1.06/28/2010PDF226.5 KB
Reset Generation for TI DSP Processor (Japanese Language)
1.03/1/2010PDF156.6 KB
Reset Generation for TI DSP Processor (Traditional Chinese Language)
1.06/28/2010PDF286 KB
Saving Power Using Closed Loop Voltage Scaling Control - White Paper (Chinese Language Version)
1.05/31/2012PDF405.9 KB
Transforming Board Management (Chinese Language)
1.010/1/2010PDF394.8 KB
Transforming Circuit Board Design
1.09/26/2011PDF424.3 KB
Transforming Circuit Board Design (Chinese Language)
1.09/26/2011PDF449.1 KB
TITLENUMBERVERSIONDATEFORMATSIZE
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LPTM10_12107_XO640
1.0110/8/2014BSM30.3 KB
LPTM10_1247_MO640
1.0110/8/2014BSM24.9 KB
Platform Manager 128 TQFP BSDL Files
1.12/26/2013ZIP8.4 KB
Platform Manager 208 ftBGA BSDL Files
1.12/27/2014ZIP10 KB
TITLENUMBERVERSIONDATEFORMATSIZE
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[IBIS] ispPAC-POWR1220AT8
0.23/2/2012IBS412.3 KB
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Selecting Power and Platform Manager Devices Excel Spreadsheet Tool
1.13/19/2012ZIP63.1 KB

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